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SpiceVision® PRO

Spice circuit和Spice模型是EDA世界的通用货币。它们由许多EDA工具生成,并提供最低级别元件的电路描述:晶体管,电容器,电阻器甚至互连,它们组合在一起产生例如IC。但对于除了最琐碎的设计之外的所有设计,Spice文件很难阅读和理解。 SpiceVision PRO在屏幕上生成电路原理图,加快调试速度并有助于解决以下设计问题:数字电路,混合信号ASIC,模拟电路,印刷电路板和MEMS。
··GraphicalSPICE网表分析器 - 用于预布局和布局后SPICE的SPICE网表查看器
··SPICE到原理图 - 用于SPICE网表和寄生网表的SPICE查看器(SPEF,DSPF,RSPF)
··基于TCP的UserWare API - 用于高级自定义和电气规则检查
··32/ 64位数据库处理当今最大的SoC和ASIC
··导出原理图和原理图片段 - Cadence Virtuoso和EDIF 2.0.0
··Cone显示 - Cone Window显示选定的片段和关键路径
··Cookie-cutting - 电路片段可以保存为单独的SPICE文件

自定义 - 基于Tcl的应用程序接口(API)允许访问内部数据库和图形用户界面(GUI)。用户可以分析设计数据并生成特定于用户的设计报告和设计检查。


多级 - 浏览器显示多个层次结构级别,从顶级概述到所有子电路级别,而多个窗口显示层次结构树,源代码和逻辑示意图。用户可以从强大的搜索引擎生成的结果列表中选择感兴趣的区域,以生成电路图。


锥形窗口 - 锥形窗口,一个“智能放大镜”,显示选定的片段,包括关键电路路径。这些电路片段可以作为单独的SPICE文件(SPICE网表导出)传输到模拟器,用于部分仿真,通常比完整电路仿真快10到100倍。


简化和自动逻辑识别 - SpiceVision PRO可以简化原理图,并行组合元件,如电容器,或创建非寄生视图,仅显示功能。自动逻辑识别从纯SPICE级网表创建数字逻辑符号,以便于设计探索。


布局后调试 - 布局提取工具生成非常大且复杂的DSPF网表和具有不同关键路径的SPF网表。可以提取,显示和保存这些路径,以进行快速关键路径仿真(寄生分析选项)。


IP - 设计的特定部分可以从完整设计中进行cookie切割(提取),并保存为SPICE网表,用作新IP或详细的SPICE仿真。


Virtuoso / SKILL - Virtuoso原理图编辑器环境选项,基于Cadence SKILL语言,自动生成电路的关键路径或部分,并将它们导出到Cadence Virtuoso原理图编辑器环境中。


快速SPICE查看器 - 在几秒钟内,SpiceVision PRO为工程师提供了对SPICE网表文件中定义的电路的更多理解。调试和优化设计更容易,并且设备可以更早地进入生产并具有更高的置信度。